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        畢業論文標題:

        糾突發錯誤譯碼器的設計

         本文ID:LWGSW17497 價格:收費積分/100
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        論文編號:DZXX384 論文字數:14528,頁數:42

        摘要
            在信息傳輸過程中,存在著干擾,這就需要在信源端的信道編碼環節中引入差錯控制編碼技術,使得在信道上的傳輸干擾損失降至最低。差錯控制編碼技術對改善誤碼率,提高通信的可靠性具有重要的作用。我經過在工程實習中研究(7,3,4)漢明碼,并在導師的指導下,通過自己的創新加于改進,使得它不但可以糾正一個隨機錯誤,還可以糾正兩個突發錯誤。按照我研究出來的這個原理我在畢業設計中編出了糾錯能力更強的譯碼電路,它們具有極強的糾錯能力,能夠糾正多位的突發錯誤,在通信系統中將受到廣泛的使用。本文介紹了利用邏輯電路,在max+plusII平臺上,使用FPGA實現驗證利用對(15,7,5)循環碼的改進創新再設計,使其能糾(15,7,5)碼中一位到七位的所有突發錯誤的新型譯碼器的設計方法,最后列出全部的設計圖紙及其時序仿真運行結果。

        關鍵詞:差錯控制,max+plusII,FPGA,譯碼器
        ABSTRACT
         In order to reduce the error caused by the noise in communication channel, the error control encoding technology will be necessary to be introduced before sending the digital message to channel in order to make the interference to the lowest point.The error control encoding technology to improves the error rate, enhances the correspondence the reliability to have the vital role. I pass through in the project practice study (7,3,4) Hamming code, and under teacher's instruction, adds through own innovation to the improvement, causes it not only to be allowed stochastically to correct to be wrong, but also may correct two burst errors This principle will study which according to me I have written the error correction ability stronger decoding circuit in the graduation project, they have the greatly strengthened error correction ability, can correct the multi- positions the burst error, will receive the widespread use in the communications system. This article introduced the use logic circuit, in the max+plusII platform, uses the FPGA realization confirmation use for (15,7,5) the cyclic code improvement innovation re-engineering, enables its to investigate (15,7,5) in the code to seven all burst errors new decoder design method, finally lists the complete design paper and its the succession simulation movement result.

        Keywords:Error control, Max+plusII, FPGA, Decoder.
        目錄
        摘要 I
        ABSTRACT II
        第1章 緒論 4
        1.1 畢業設計內容及安排………………………………………………………… 4
        1.2 課題的歷史及發展狀況……………………………………………………… 4
        1.3 課題的應用情況……………………………………………………………… 5
        1.4課題的理論背景及研究現狀…………………………………………………… 6
        第2章 開發平臺及其軟件介紹 9
        2.1 FPGA介紹……………………………………………………………………… 9
        2.2 設計思路與任務……………………………………………………………… 9
        2.3 FPGA的優點…………………………………………………………………… 10
        第3章 循環碼譯碼的基本原理 12
        3.1 循環碼譯碼的一般原理……………………………………………………… 12
        3.1.1循環碼譯碼概述………………………………………………………… 12
        3.1.2 循環碼的生成矩陣和一致校驗矩陣…………………………………… 13
        3.2 循環碼的糾錯能力…………………………………………………………… 15
        第4章 譯碼主要過程 16
        4.1 循環碼的譯碼過程…………………………………………………………… 16
        4.2 工程上循環碼的譯碼過程…………………………………………………… 19
        4.3 循環碼糾多位突發錯誤譯碼器設計………………………………………… 25
        第5章 結論 36
        致謝 37
        參考文獻 38


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