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    基于VHDL語言的大數(shù)邏輯譯碼器設(shè)計(jì)

     本文ID:LWGSW12102 價(jià)格:收費(fèi)積分/100
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    電子信息工程論文編號:DZXX271  論文字?jǐn)?shù):9158,頁數(shù):27

    目錄
    摘要 I
    ABSTRACT II
    第1章 緒論 1
    1.1 背景 1
    1.2 開發(fā)平臺及語言介紹 2
    1.2.1 開發(fā)平臺 2
    1.2.2 開發(fā)語言 3
    第2章 循環(huán)碼及其譯碼 4
    2.1數(shù)字通信的組成和我們的關(guān)注點(diǎn) 4
    2.2線性分組碼的生成矩陣和校驗(yàn)矩陣 4
    2.3 循環(huán)碼相關(guān)原理 5
    2.3.1 循環(huán)碼的定義 5
    2.3.2 循環(huán)碼的多項(xiàng)式 5
    2.3.3 由生成多項(xiàng)式的根定義系統(tǒng)循環(huán)碼 6
    2.3.4 循環(huán)碼的譯碼 7
    2.4 一種特殊的循環(huán)碼 7
    第3章 大數(shù)邏輯譯碼原理 9
    3.1 一步大數(shù)邏輯譯碼基本原理 9
    3.2[7,4,3]大數(shù)邏輯譯碼器原理 11
    3.3[7,4,3]大數(shù)邏輯譯碼器基本原理圖及仿真 12
    3.4[7,4,3]大數(shù)邏輯譯碼器改進(jìn)譯碼圖及仿真 13
    第4章 譯碼電路VHDL語言實(shí)現(xiàn) 15
    4.1[7,4,3]大數(shù)邏輯譯碼VHDL語言實(shí)現(xiàn) 15
    4.2 移存和判斷模塊VHDL語言實(shí)現(xiàn) 18
    4.2.1模塊代碼及符號 18
    4.2.2 模塊時(shí)序圖分析 20
    4.3 含模塊的連續(xù)譯碼完整電路及仿真 20
    第5章 畢業(yè)設(shè)計(jì)總結(jié) 22
    致謝 23
    參考文獻(xiàn) 24

    摘要
     
     通信的目的是要把對方不知道的消息及時(shí)可靠地傳送給對方,所以里面有一個(gè)消息可靠性的問題,糾錯(cuò)碼就是在這一問題上誕生的,而大數(shù)邏輯譯碼是一種較簡單的譯碼方法,在實(shí)際中有較廣泛的應(yīng)用,是一個(gè)比較實(shí)在的譯碼方式。[7,4,3]循環(huán)漢明碼是典型的兩步大數(shù)邏輯可譯碼。掌握循環(huán)漢明碼也就掌握了大數(shù)邏輯譯碼的實(shí)質(zhì)。
     近些年來,F(xiàn)PGA(Field Programmable Gate Array)在電子設(shè)計(jì)技術(shù)領(lǐng)域的光芒已不可掩蓋。它的出現(xiàn)使硬件設(shè)計(jì)有時(shí)如同軟件設(shè)計(jì)那樣靈活、快捷。本次課題設(shè)計(jì)采用的ALTERA公司開發(fā)的MAX+PLUSⅡ軟件具有全集成化的可編程邏輯設(shè)計(jì)環(huán)境,可編程邏輯器件可以通過軟件編程而對其硬件的結(jié)構(gòu)和工作方式進(jìn)行重構(gòu),縮短了系統(tǒng)研制周期。
     本課題可以深刻理解大數(shù)邏輯譯碼原理,在此基礎(chǔ)上設(shè)計(jì)譯碼電路并用VHDL語言編寫程序?qū)崿F(xiàn)原理功能,達(dá)到學(xué)科間的交叉。此課題對于我們的邏輯思維是一種很好的鍛煉。

    關(guān)鍵詞:糾錯(cuò)碼,大數(shù)邏輯譯碼,VHDL
     
    ABSTRACT
     Communication is aiming to transmit reliable information to each other from one side to the other side in a timely, So there is a problem of the reliability of the information, error-correcting code is on this issue of birth, and the Majority-logic decoding is a relatively simple decoding methods, in practice, it is widely used, it’s a real way of decoding. [7,4,3] Cycle Hamming codes is a typical two-step majority logic decoding. Having mastered the cycle Hamming codes is mastering the Majority-logic decoding.
     In recent years, FPGA (Field Programmable Gate Array) is a very popular name  in electronic design technology, Domain light can not be covered up. It’s appearance is sometimes making hardware design and software design flexibly and efficiently. This design uses Altera Corporation’s product MAX + PLUS II. This software is confined to the provision of integrated programmable logical design environment, Programmable logic devices can be programmed through software and hardware structure and work methods for reconstruction, then shorten the development cycle of the system.
     From this topic, we can be profound understanding Majority-logic decoding theory, On this basis, designing decoding circuit and using VHDL to implement Principle function, making two subjects to the crossover. The subject to our logical thinking is a good exercise.
     
    Keywords:Error-correcting code, Majority-logic decoding, VHDL.


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