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      基于CPLD的SPWM波形發生器的設計

       本文ID:LWGSW3106 價格:128元
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      電氣自動化論文編號:ZD235 論文字數:10427,頁數:33

      目 錄

      摘要…………………………………………………………………………………………Ⅰ
      Abstract……………………………………………………………………………………Ⅱ
      任務書
      緒論…………………………………………………………………………………………1
      第一章  引言………………………………………………………………………………1
        1.1 SPWM技術的應用……………………………………………………………………1
      1.2 設計思路……………………………………………………………………………2
      第二章  工作原理…………………………………………………………………………3
        2.1 基本組成……………………………………………………………………………3
      2.2 工作過程……………………………………………………………………………3
      第三章  設計原理…………………………………………………………………………5
      3.1 系統原理…………………………………………………………………………5
      3.1.1CPLD內部設計…………………………………………………………………5
      3.1.2SPWM波形生成原理……………………………………………………………9
      3.2系統邏輯設計……………………………………………………………………9
      3.2.1系統總線接口單元…………………………………………………………………9
      3.2.2過流、欠壓、IPM保護邏輯…………………………………………………9
      3.2.3三角載波產生…………………………………………………………………9
      3.2.4正弦調制波的產生……………………………………………………………9
      3.2.5正弦調制波幅值的調節………………………………………………………10
      3.2.6三相正弦信號的產生…………………………………………………………10
      3.2.7不對稱控制設計………………………………………………………………11
      3.2.8系統邏輯與時序功能仿真……………………………………………………11
      第四章 選用的 PLD………………………………………………………………………15
      4.1 PLD/FPGA 結構與原理初步…………………………………………………………15
      4.1.1基于乘積項(Product-Term)的PLD結構…………………………………………15
      4.1.2 乘積項結構PLD的邏輯實現原理…………………………………………………17
      第五章:設計程序…………………………………………………………………………19
      5.1 語言……………………………………………………………………………………19
      CPLD各模塊的設計……………………………………………………………19
      5.2.1 控制寄存器的設計…………………………………………………………………19
      5.2.2 分頻比可變的分頻器模塊設計……………………………………………………21
      5.2.3尋址計數器設計……………………………………………………………………22
      5.2.4 模360加法器設計………………………………………………………………23
      5.2.5 查找表ROM設計…………………………………………………………………24
      5.3 實現程序………………………………………………………………………………25
      結論………………………………………………………………………………26
      致謝…………………………………………………………………………………………27
      參考文獻………………………………………………………………………………… 28

      摘 要


        提出了一種基于CPLD的全數字高頻脈寬調制器的實現電路,并對電路的工作原理和工作過程進行了詳細的敘述,給出了實驗波形和實驗數據。本實驗運用了Verilog  HDL語言,Verilog HDL就是在用用最廣泛的C語言的基礎上發展起來的一種件描述語言實驗結果證明了這種電路的實用性和正確性。
       關鍵詞: 調制器/同步信號;數字脈寬調制器  Verilog  可編程器件


       
       
       According to the CPLD SPWM a form takes place the design of the machine
       
       
      Abstract
       
         Put forward a kind of high fervency in word in total amount vein breadth that base on the CPLD make the machine realizes electric circuit, and to the work principle of the electric circuit with work the process proceeded the detailed description, giving the experiment a form with the experiment data. This experiment made use of the language of Virile HDL, the Virile HDL is in phonetic foundation in the most extensive C that with a kind of a function for describing language experiment result proof this kind of electric circuit to develop with the accuracy.

       Key words: Make the machine/ synchronous signal; The arithmetic figure vein breadth makes programmable machine in Virile in machine piece


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