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    畢業(yè)論文標題:

    AT89S51上實現(xiàn)數(shù)字鐘計時設計

     本文ID:LWGSW12080 價格:收費積分/100
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    本站會員可自行下載:下載地址 AT89S51上實現(xiàn)數(shù)字鐘計時設計 (收費:11800 積分)  

    電子信息工程論文編號:DZXX293  論文字數(shù):13589,頁數(shù):38

    目錄
     
    摘要 I
    ABSTRACT II
    第一章 課題與開發(fā)工具介紹 1
    1.1 課題綜述 1
    1.1.1 單片機及可編程邏輯器件概述 1
    1.1.2 課題意義及設計方法 1
    1.2 軟件工具 3
    1.2.1 MAXPLUS II 3
    1.2.2 Verilog HDL硬件描述語言 4
    1.2.3 CPLDDN下載軟件 6
    1.3 硬件工具 7
    1.3.1 KHF-4型CPLD實驗/開發(fā)系統(tǒng)簡介 8
    1.3.2 TOP851V5編程器 10
    第二章 單片機的系統(tǒng)設計 12
    2.1 AT89S51單片機基本介紹 12
    2.2 AT89S51上實現(xiàn)數(shù)字鐘計時設計 14
    2.2.1 實現(xiàn)數(shù)字鐘計時的基本方法 14
    2.2.2 程序流程 15
    2.3 數(shù)字鐘計時程序設計(c51) 16
    第三章 CPLD的系統(tǒng)設計 21
    3.1 CPLD的介紹 21
    3.2 Verilog HDL語言程序設計 23
    第四章 編程下載及調試 29
    4.1 下載 29
    4.2 調試 30
    4.2.1 管腳分配 30
    4.2.2 系統(tǒng)聯(lián)調出現(xiàn)的問題和解決方法 31
    第五章 總結 34
    第六章 致謝 35
    參考文獻 36

    摘要
     單片微型計算機(單片機)自問世以來,因其小巧靈活、成本低、控制能力強、易于產品化等優(yōu)勢,在社會各領域中得到廣泛的應用。隨著社會發(fā)展,單片機芯片在速度、規(guī)模、性能等指標方面面臨著新的挑戰(zhàn)。與此同時,可編程邏輯器件向著高密度,高速度,低價格方向的發(fā)展,特別是VHDL、VerilogHDL等硬件描述語言改革了傳統(tǒng)的數(shù)字系統(tǒng)的描述方法和設計方法。軟件實現(xiàn)硬件化、硬件實現(xiàn)軟件化、用戶自制大規(guī)模和超大規(guī)模集成電路等過去被認為是夢想的事情而今都成為了現(xiàn)實。
       本課題是利用資源豐富、控制靈活及良好人機對話功能的AT89S51單片機和具有內部結構重組、復雜可編程的CPLD芯片結合起來,實現(xiàn)了數(shù)字鐘計時功能。采用C語言編寫單片機的計時功能并將其數(shù)值送給CPLD。VerilogHDL語言完成接受單片機送來的數(shù)據(jù)并把該數(shù)據(jù)送LED數(shù)碼管顯示。這樣對于單片機而言,LED時鐘就完全相當于靜態(tài)LED,達到了節(jié)約單片機的資源、減少了單片機的軟件開銷。
     
     關鍵字:復雜可編程器件,VerilogHDL語言,單片機,數(shù)字鐘

    ABSTRACT
     Microcomputer (SCM) is widely used in the various areas because of its compact flexible, low cost, strong ability to control, easy using for product. Along with social development, the speed, size, performance indicators of SCM is facing new challenges. Meanwhile, the programmable logic device toward high density, high speed, low price of development, particularly the hardware description language such as VHDL, VerilogHDL has brought a reform of the traditional digital system description and design methods. Users made large and ultra-large-scale integrated circuits, etc. over and the dream is that things have now become a reality.
      The topic is the use of rich resources, control of flexible man-machine dialogue and good function of SCM and minicomputer with internal restructuring. complex programmable chip CPLD is the perfect combination to achieve a digital clock timing. Using the C language function SCM time given its numerical CPLD. Verilog HDL completed accept SCM data sent and the digital data sent LED Display. For the microcontroller, LED clock completely equivalent static LED, SCM achieve the savings achieved savings MCU resources and reduce the SCM software spending.

    Keywords: CPLD,VerilogHDL language,single-chip microcomputer (SCM),digital clock


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